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TDR(Time Domain Reflectometry)時域反射是一種通用的阻抗測量技術,普遍應用于PCB、FPC、電纜、連接器等領域。隨著計算機和通信系統(tǒng)的串行總線速度明顯提高,對走線要求越來越高。如果您的電路板操作在1Gbps或以上,電路板,軟板只是滿足規(guī)范的差分阻抗是不夠的。在當前和下一代電路板,滿足損耗也是重要的規(guī)格了。
PCB設計兩大問題
一、如何驗證PCB,F(xiàn)PC走線的特征阻抗和傳輸損耗是否達到設計要求成為了PCB生產商以及高速數(shù)字電路設計人員必須關注的問題。
二、在PCB、FPC設計生產階段,如何按照設計文檔進行傳輸線損耗的設計與測試,布局、走線有哪些需要注意的地方,也是持續(xù)困擾PCB,FPC生產廠商產品前期導入的問題。
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研討會安排
主辦單位:泰克科技(中國)有限公司
捷泰科技(中國)有限公司
時間:2019年12月17日 星期二
地點:深圳市同泰萬怡酒店 宴會廳1
(深圳市寶安區(qū)寶安大道6259號)
報名方式:掃描二維碼或者點擊閱讀原文
報名參加并到場的聽眾均可參與現(xiàn)場抽獎活動,獎品豐厚,請速速報名哦!